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LMK5C33414ARGCR

Name: Texas Instruments LMK5C33414ARGCR
Brand: Texas Instruments
SKU: 595-LMK5C33414ARGCR
Price: 32.15 EUR
Availability: OutOfStock

Bilder dienen lediglich der Veranschaulichung und sind nicht Originalgetreu
Siehe Produktspezifikationen

Mouser-Nr.:

595-LMK5C33414ARGCR

Herst.- Nr.:

LMK5C33414ARGCR

Herst.:

Texas Instruments

Beschreibung:

Clock-Synthesizer / Jitter-Reiniger Three DPLL three AP LL four-input and 1

Datenblatt:

LMK5C33414ARGCR Datenblatt

ECAD Model:

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Hersteller:	Texas Instruments
Produktkategorie:	Clock-Synthesizer / Jitter-Reiniger
Lieferbenachrichtigungen:	Für den Export dieses Produkts aus den USA ist möglicherweise zusätzliche Dokumentation erforderlich.
RoHS:
Anzahl der Ausgänge:	14 Output
Max. Ausgangsfrequenz:	1.25 GHz
Ausgangsstufe:	HSCL, HSDS/ LVPECL, LVCMOS, LVDS
Eingabestufe:	HCSL, LVCMOS, LVDS, LVPECL, XTAL
Verpackung/Gehäuse:	VQFN-64
Maximale Eingangsfrequenz:	200 MHz, 800 MHz
Versorgungsspannung - Min.:	3.135 V
Versorgungsspannung - Max.:	3.465 V
Minimale Betriebstemperatur:	- 40 C
Maximale Betriebstemperatur:	+ 105 C
Serie:	LMK5C33414A
Montageart:	SMD/SMT
Marke:	Texas Instruments
Land der Bestückung:	Not Available
Land der Verbreitung:	Not Available
Ursprungsland:	Not Available
Feuchtigkeitsempfindlich:	Yes
Betriebsversorgungsstrom:	850 mA, 965 mA, 1.085 A
Produkt:	Clock Jitter Cleaners / Synchronizers
Produkt-Typ:	Clock Synthesizers / Jitter Cleaners
Verpackung ab Werk:	2500
Unterkategorie:	Clock & Timer ICs
Typ:	Network Synchronizer and Jitter Cleaner

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PCN

Product Change Notification 2025-3-28 (PDF)

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USHTS:: 8542390090
MXHTS:: 8542399999
ECCN:: 3A001.A.2.A

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Der Texas Instruments LMK5C33414A leistungsstarke Netzwerk-Synchronisierer enthält einen Jitter-Cleaner, der die strengen Anforderungen von drahtlosen Kommunikations- und Infrastrukturapplikationen erfüllt. Der Netzwerk-Synchronisierer integriert drei DPLLs, um einen störungsfreien Jitter und eine Schaltdämpfung mit programmierbarer Schleifenbandbreite und ohne externe Schleifenfilter zu gewährleisten. Diese Funktion maximiert die Flexibilität und Benutzerfreundlichkeit des Bauteils. Jede DPLL-Phase sperrt eine gepaarte APLL auf einen Referenzeingang.